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LVDS是一種低擺幅差分信號技術，使用非常低的幅度信號，通過一對差分PCB連線或者平衡電纜傳輸數(shù)據(jù)，它可以達到每秒數(shù)百兆比特以上的傳輸速率，而且具有很多優(yōu)點：恒定的驅動電流、低功耗、簡單的PCB板的設計、良好的抗電磁干擾，對于電源、地、外部環(huán)境的噪聲的不敏感等。在國際標準ANsI／EIA一644中，主要定義了LVDS的電特性，并建議了655 Mbps的最大速率和1．823 Gbps的無失真媒質上的理論極限速度；在IEEE P1596．3中，主要面向SCI(ScalableCoherent Interface)，定義了LVDS的電特性，還定義了SCI協(xié)議中包交換時的編碼。
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