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時序邏輯電路的輸出不但和當前輸入有關，還與系統(tǒng)的原先狀態(tài)有關，即時序電路的當前輸出由輸入變量與電路原先的狀態(tài)共同決定。為達到這一目的，時序邏輯電路從某一狀態(tài)進入下一狀態(tài)時，必須首先設法“記住”原先的狀態(tài)。作為時序邏輯電路的基本特征，時序邏輯電路應具有“記憶”功能。觸發(fā)器是時序電路最常用的記憶元件。本章將首先介紹常用觸發(fā)器的設計方法，然后介紹常用的時序電路：計數(shù)器、寄存器、移位寄存器、狀態(tài)機等。
6.1 基本D觸發(fā)器的設計
6.2 JK觸發(fā)器
6.3 帶異步復位/置位端的使能T觸發(fā)器
6.4 基本計數(shù)器的設計
6.5 同步清零的計數(shù)器
6.6 同步清零的可逆計數(shù)器
6.7 同步預置數(shù)的計數(shù)器
6.8 帶進制的計數(shù)器
6.9 基本移位寄存器的設計
6.10 同步預置數(shù)串行輸出移位寄存器
6.11 循環(huán)移位寄存器
6.12 6位雙向移位寄存器
6.13 有限狀態(tài)機的設計
習題
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