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電子發燒友網>電子資料下載>嵌入式開發>應用于片上系統中低功耗IP核設計的自適應門控時鐘技術

應用于片上系統中低功耗IP核設計的自適應門控時鐘技術

2011-02-23 | ??它 | 1.11 MB | 次下載 | 免費

資料介紹

摘要:門控時鐘技術一直以來是降低芯片動態功耗的有效方法,文章結合片上系統(SOC)的結構特性和設計特點,分析已有的各種門控時鐘技術的優缺點,指出這些缺點是SOC設計中嚴重障礙,隨后抽象出IP核工作模型,提出了僅用非常簡單的邏輯就可以方便應用于IP核的自適門控時鐘技術,這種技術在不影響性能的前提下,可以根據IP核的應用狀況自動開關時鐘,不但可以降低動態功耗,還可以結合門控電源技術降低漏電功耗,對一款真實SOC中浮點IP核的改造實驗表明,在不降低性能的前提下,可以平均降低62.2%的動態功耗,同時理論上平均降低70.9%的漏電功耗。

關鍵詞:門控時鐘;IP核;片上系統;低功耗設計

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